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'RDL'통합검색 결과 입니다. (4건)

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LB세미콘·LB루셈, 해외 고객사와 AI 서버용 제품 양산 진행

LB세미콘은 자회사 LB루셈과 협력해 해외 주요 고객사의 AI 데이터센터용 제품 양산을 위한 신규 프로젝트를 진행한다고 11일 밝혔다. 해당 프로젝트는 LB세미콘과 LB루셈의 신기술을 활용해, 웨이퍼 전·후면 처리를 '턴키(Turn-key)' 방식으로 제공하는 것을 목표로 한다. 진행 시점은 내년 2분기부터다. LB루셈은 전력반도체 공정을 위한 ENIG(무전해 도금) 공정 설치와 타이코(TAIKO) 그라인딩 공정에 투자해 왔다. 타이코 그라인딩은 일본 디스코사가 개발한 기술로, 웨이퍼의 가장자리를 남기고 연삭해 웨이퍼의 강도를 높인다. 이를 기반으로 LB세미콘은 BGBM(Back Grinding Back Metal)·RDL(재배선)·ENIG·타이코 그라인딩·MOSFET 웨이퍼 테스트에 이르는 전력반도체용 턴키 공정을 구축했다. LB루셈은 해당 턴키 솔루션을 내년 본격적으로 양산할 계획이다. BGBM은 실리콘 웨이퍼를 얇게 연삭한 뒤, 후면에 전기회로 역할을 하는 금속을 증착해주는 공정이다. LB루셈의 BGBM은 웨이퍼를 30마이크로미터(um), 도금을 50마이크로미터 수준으로 매우 얇게 구현할 수 있다. LB세미콘과 LB루셈은 이 같은 기술을 활용해 일본 R사, 미국 V사와 임베디드 SPS(Substrate Power Supply)를 개발하고 있다. 임베디드 SPS는 기판 자체에 전원 공급 장치를 넣는 방식이다. 기존 기판과 분리된 SPS 대비 방열 특성이 우수해, AI 서버 및 데이터센터 시장에서 수요가 증가할 것으로 전망된다. LB세미콘 관계자는 "임베디드 SPS를 활용하면 열 효율이 개선돼 기존 1천W 전력의 서버를 1천500~3천W로 확장할 수 있게 된다"며 "웨이퍼 두께 또한 매우 얇은 30마이크로미터대가 요구되는데, LB세미콘과 LB루셈의 기술을 턴키로 제공하면 충분히 구현할 수 있다"고 설명했다. LB세미콘과 LB루셈은 내년 2분기 고객사의 AI 반도체용으로 품질 테스트에 돌입할 예정이다. 테스트 결과에 따라 이르면 내년 중반부터 본격적인 양산이 시작될 것으로 전망된다. 양산 규모는 초기 월 1천장에서 6개월 내 5천장 수준으로 높이는 것이 목표다. LB루셈 관계자는 "전력 반도체와 AI 데이터센터 시장의 확장에 발맞춰 혁신적인 공정을 개발하고 있다"며 "LB세미콘과 LB루셈의 기술력이 글로벌 반도체 산업의 미래를 선도할 것"이라고 강조했다.

2024.12.11 09:56장경윤

LB세미콘-DB하이텍, 전력반도체 개발 협업키로…내년 1분기 양산 목표

LB세미콘은 DB하이텍과 협력해 고전력소자 제품용 RDL(재배선층) 개선 제품을 개발 중이라고 4일 밝혔다. 양사는 2025년 1분기 양산을 목표로 RDL 기술 개발을 진행 중이다. 현재 제품 신뢰성을 높이는데 중점을 두고 있으며, 이를 위해 제품 구조 개선과 소재를 변경했다. LB세미콘은 특히 저비용을 목표로 하는 전력 반도체 RDL 개선 제품 개발에 집중하고 있다. DB하이텍과의 협업에는 LB루셈도 참여한다. LB세미콘은 프런트 사이드(Front Side) 공정을 맡고, LB루셈은 백 사이드(Back Side) 공정을 담당해 각사의 기술적 강점을 최대한 활용한다는 계획이다. 또한 LB세미콘은 DB하이텍의 탄화규소(SiC), 질화갈륨(GaN) 제품 개발에도 참여한다. DB하이텍은 현재 8인치 SiC·GaN 반도체 신사업을 추진 중이다. SiC와 GaN은 차세대 전력 반도체 소재다. 기존 실리콘 기반 반도체보다 물성이 좋아 전기차, 에너지저장장치(ESS), 인공지능(AI) 응용처 등에 쓰인다. LB세미콘과 LB루셈은 이번 협업을 통해 안정적인 파운드리 파트너를 확보하게 됐다. 또 빠른 성장이 예상되는 전력 반도체 사업에 진출할 수 있는 기반을 마련하게 됐다는 점에서도 의미가 크다. 회사는 이번 협력을 바탕으로 전력 반도체의 신뢰성과 기술력을 더욱 높이겠다는 방침이다. 시장조사기관 야노경제연구소에 따르면 2022년 전 세계 전력반도체 시장은 239억 달러(한화 약 32조2천230억원)에서 2030년 370억 달러(약 48조원)로 성장할 전망이다. LB세미콘 관계자는 "DB하이텍과의 기술 협력을 통해 미래 성장 동력을 확보하고, 급성장하는 차세대 고부가 전력 반도체 시장을 주도할 수 있는 기반을 마련하게 됐다"고 말했다.

2024.12.04 09:44장경윤

ACM리서치, FOPLP 패키징용 신형 도금장비 출시

ACM리서치는 팬아웃-패널레벨패키징(FOPLP)용 신형 '울트라(Ultra) ECP ap‐p' 패널 전기화학 도금 장비를 출시했다고 27일 밝혔다. 이 장비는 ACM 리서치가 자체적으로 개발한 수평식 도금 방식을 적용해 전체 패널에 걸쳐 우수한 균일성과 정밀도를 확보했다. 데이비드 왕 ACM 사장 겸 CEO는 "FOPLP는 높은 대역폭과 높은 밀도의 칩 간 상호연결을 제공할 수 있어 발전 잠재력이 더 크다"며 "Ultra ECP ap-p 장비는 패널 레벨 애플리케이션용 수평식 도금 방식을 채택한 최초의 장비 중 하나"라고 설명했다. 그는 이어 "이번 장비는 ACM이 전통적인 첨단 패키징의 웨이퍼 레벨 도금 및 구리 공정에서 축적해 온 풍부한 기술을 활용하고 있다"며 "GPU와 고밀도 고대역폭메모리(HBM)에도 적용될 수 있을 것이라 믿는다”고 덧붙였다. ACM 리서치의 Ultra ECP ap‐p 장비는 515mm x 510mm의 패널을 가공할 수 있으며, 옵션으로 600mm x 600mm 버전도 제공된다. 이 장비는 유기 재료와 유리 재료를 겸용할 수 있으며 실리콘 관통 전극(TSV) 충전, 구리 기둥, 니켈(Ni), 주석-은(SnAg) 도금, 솔더 범핑에 대한 지원 능력도 포함한다. 또한 새로운 장비는 구리, 니켈, 주석-은과 금 도금을 필요로 하는 고밀도 팬아웃(HDFO) 제품에 사용할 수 있다. Ultra ECP ap‐p 장비는 ACM 리서치가 자체적으로 개발한 기술을 적용하여 전체 패널의 전기장을 정확하게 제어할 수 있다. 이 기술은 다양한 제조 공정에 적용되어 전체 패널의 일치한 진공 세정 효과를 확보하고 나아가 패널 내부와 패널 사이의 우수한 균일성을 확보한다. 또한 Ultra ECP ap‐p 장비는 수평(평면) 진공 세정 방식을 적용해 패널 전송 과정에 발생하는 홈통간 오염을 통제하고 다른 진공 세정액 간의 교차 오염을 효과적으로 감소할 수 있어 서브미크론 RDL(redistribution layer)과 마이크로 컬럼을 갖춘 대형 패널의 이상적인 선택이 될 수 있다. 이외에도 해당 장비는 탁월한 자동화와 로봇팔 기술까지 적용해 전체 공정 과정에서 패널이 고효율적이고 고품질적으로 전송될 수 있게 했다. 자동화 프로세스는 전통적 웨이퍼 처리 과정과 유사하지만, 더 크고 더 무거운 패널을 처리하기 위해 패널 턴 유닛을 별도로 추가했다. 이를 통해 정확하게 위치를 정하고 패널을 전이시켜 하향 도금 등을 편리하게 지원하며, 처리 정확성과 고효율성을 확보했다.

2024.08.27 10:13장경윤

네패스, 세계 최초 8 레이어 RDL 인터포저 기술 공개

네패스는 지난달 28일부터 31일(현지 시각)까지 미국 콜로라도주 덴버에서 열린 제74회 전자부품기술학회(ECTC)에서 팬아웃 기반 RDL 인터포저 기술을 선보였다고 3일 밝혔다. 네패스는 행사 이튿날인 29일, 미래 패키지 재료 기술의 열기계적 응력 및 신뢰성 분석 세션 에서 '팬아웃 RDL 인터포저와 실리콘 브릿지 기술을 기반으로 한 싱글 및 멀티 NPU 칩렛 이종 접합 패키징'이라는 주제의 논문과 함께 첨단 패키징 기술 현황을 공유했다. 해당 기술은 인터포저 위에 여러 칩을 수직∙수평으로 연결하는 칩렛 패키징을 실리콘(Si) 인터포저 대신 팬아웃 공정 기반의 재배선(RDL) 인터포저로 구현한 것이 특징이다. 인공지능 반도체 수요 증가에 따라 칩렛 패키징 기술이 주요 화두인 가운데 우수한 전기적 특성 및 생산 효율성, 제조 비용 절감 등의 장점으로 현장 참가자들의 높은 관심을 받았다. 특히 이번 ECTC에서는 세계적으로 6 레이어 RDL 인터포저 기술이 일반적인 상황에서 기존보다 2 레이어를 더 쌓은 8 레이어 RDL 인터포저 기술을 개발 및 공유했다. 이는 과거 기판(Substrate)이 필요한 구조에서 기판이 필요 없는 구조가 됐다는 점에서 의미가 있다. 즉 기존의 경우 RDL 인터포저 제작 및 칩 접착과 몰딩 등의 공정 이후에 기판(Substrate) 위에 추가적으로 플립칩 공정을 진행해야 한다. 그러나 8 레이어 공정은 기판 위에 플립칩 공정이 필요 없어지면서 별도 기판없이 패키징이 가능해 전체 패키지 사이즈를 줄일 수 있다. 또한 공정이 간소화되면서 공정 효율성이 높아지고 복잡했던 기판과의 전기적 연결이 간결해지면서 우수한 전기적 특성 구현이 가능하게 되었다. 네패스 관계자는 “RDL 인터포저는 다양한 칩들을 연결하는데 적합한 솔루션으로 앞으로 시장 성장 잠재력이 매우 큰 추론용 인공지능의 엣지 컴퓨팅 분야 등에서 폭넓게 활용될 것으로 예상된다”며 “향후 네트워크 강화 및 고객사 기술 협력을 통해 상용화에 적극 나서 글로벌 반도체 패키지 경쟁력을 확보해 나갈 계획”이라고 밝혔다.

2024.06.03 15:31장경윤

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