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SK하이닉스, AI 추론 병목 줄이는 '커스텀 HBM' 정조준

SK하이닉스가 향후 다가올 커스텀 HBM(고대역폭메모리) 시대를 위한 무기로 '스트림DQ(StreamDQ)'를 꺼내 들었다. 기존 GPU가 담당해 추론 과정에서 병목 현상을 일으키던 작업을, HBM이 자체적으로 수행해 데이터 처리 성능을 끌어올리는 것이 골자다. GPU 업체 입장에서도 HBM으로 일부 기능을 이전할 수 있기 때문에 칩 설계를 보다 유연하게 할 수 있다는 이점이 있다. SK하이닉스는 해당 기술을 통해 엔비디아 등 주요 고객사와 협의를 진행할 것으로 관측된다. SK하이닉스는 지난 6일(현지시간) 미국 라스베이거스 베니션 호텔에서 'CES 2026' 프라이빗 전시관을 마련하고 커스텀 HBM 기술을 공개했다. 커스텀 HBM 시장 정조준…고객사에 '스트림DQ' 기술 제안 커스텀 HBM은 차세대 버전인 HBM4E(7세대 HBM)부터 본격적으로 적용될 것으로 전망되는 제품이다. 기존 HBM이 표준에 따라 제작됐다면, 커스텀 HBM은 고객사가 원하는 기능을 베이스 다이에 추가하는 것이 가장 큰 차별점이다. 베이스 다이는 HBM을 적층한 코어 다이의 메모리 컨트롤러 기능을 담당하는 칩으로, HBM과 GPU 등의 시스템반도체를 PHY(물리계층)로 연결한다. 기존에는 메모리 회사가 이를 제조했으나, 다양한 로직 기능이 추가되면서 HBM4부터는 주로 파운드리 공정을 통해 양산된다. SK하이닉스는 커스텀 HBM 상용화를 위해 고객사에 스트림DQ라는 기술을 제안하고 있다. 얼마전 막을 내린 CES 2026 전시관이 고객사 대상으로 운영된 만큼, 엔비디아 등 글로벌 빅테크에 적극적인 프로모션을 진행했을 것으로 예상된다. SK하이닉스 관계자는 "스트림DQ는 커스텀 HBM의 한 사례로서, SK하이닉스는 해당 기술을 논문으로도 냈다"며 "고객사가 커스텀 HBM 관련 기술을 우리에게 제안하기도 하지만, 반대로 SK하이닉스가 제시하기도 한다"고 설명했다. GPU 일부 기능 HBM으로 이전…빅테크 부담 덜어준다 스트림DQ 기술은 기존 GPU 내부의 컨트롤러 기능 일부를 HBM의 베이스 다이로 이전하는 것이 주 골자다. 이렇게 되면 GPU 제조사는 칩 내부 공간을 더 넓게 쓸 수 있어, 시스템반도체의 성능 및 효율성 향상을 도모할 수 있다. SK하이닉스 입장에서는 베이스 다이에 GPU 컨트롤러 등을 추가하더라도 큰 부담이 없다. 대만 주요 파운드리인 TSMC의 선단 공정을 적용하기 때문이다. 또한 SK하이닉스는 해당 베이스 다이에 UCIe 인터페이스를 적용해 칩의 집적도를 더 높였다. UCIe는 칩을 기능별 단위로 분할해 제조한 후, 서로 연결하는 최첨단 기술이다. HBM이 '역양자화' 대신 처리…LLM 처리 속도 7배 향상 가능 AI 가속기의 데이터 처리 성능 역시 획기적으로 높아진다. 대규모언어모델(LLM)은 메모리 사용량을 효율적으로 감축하기 위해 낮은 비트 정수로 데이터를 압축하는 '양자화(Quantization)' 과정을 거친다. 이후 실제 연산 과정에서는 데이터를 다시 압축 해제하는 '역양자화(Dequantization)'를 진행한다. 기존 역양자화 작업은 GPU가 담당했다. 그런데 GPU가 역양자화를 진행하면 전체 LLM 추론 시간의 최대 80%를 잡아먹는 메모리 병목 현상을 일으키는 문제가 발생해 왔다. 반면 스트림DQ는 양자화된 정보를 그대로 GPU에 보내는 것이 아니라, HBM 내부에서 데이터가 흘러가는 과정에서 역양자화를 곧바로(on-the-fly) 진행한다. 덕분에 GPU는 별도의 작업 없이 곧바로 연산 작업을 진행할 수 있게 된다. 이처럼 흘러가는(스트림) 데이터를 곧바로 역양자화(DQ)한다는 관점에서 스트림DQ라는 이름이 붙었다. 이를 통해 병목 현상이 발생했던 LLM 추론 처리 속도가 약 7배 이상으로 개선될 수 있다는 게 SK하이닉스의 설명이다. 전체 AI 가속기의 추론 속도 역시 크게 향상될 것으로 기대된다. SK하이닉스 관계자는 "방대한 양의 데이터를 처리하는 시스템반도체를 메모리 근처에 가져다 놓고 데이터 결과값만 받게 하면 시스템적으로 굉장히 효율적"이라며 "프로세싱 니어 메모리(PNM)의 개념으로 볼 수 있다"고 말했다.

2026.01.14 13:48장경윤

퀄리타스반도체, 'ICCAD 2025'서 차세대 고성능 인터커넥트 기술 시연

초고속 인터페이스 IP 개발 전문기업 퀄리타스반도체가 중국 청두에서 지난 20일부터 양일간 개최된 'ICCAD 2025'에 부스로 참가해 PCIe Gen 6.0 PHY IP와 UCIe Standard v2.0 솔루션의 라이브 데모를 성공적으로 시연했다고 25일 밝혔다. 퀄리타스반도체는 이번 전시회에서 AI, HPC, 데이터센터 시장이 요구하는 차세대 고성능 인터커넥트 기술력을 실시간으로 시연함으로써 글로벌 경쟁사 대비 우수한 성능과 안정성을 현장에서 입증했다. 특히 64Gbps PAM4 기반 PCIe Gen 6.0 PHY IP와 UCIe Standard 패키지 v2.0 표준을 지원하는 Die-to-Die 인터커넥트 IP 솔루션은 참관객 및 업계 관계자들로부터 큰 호응을 얻었다. 최근 퀄리타스반도체는 PCIe Gen 6.0 PHY IP에 대한 신규 계약을 성공적으로 체결하며 시장 경쟁력을 재차 입증했다. 이번 라이브 데모를 통해 기술 신뢰도가 한층 강화되면서 향후 신규 레퍼런스 확보에도 긍정적인 영향을 줄 것으로 기대된다. 더불어 퀄리타스반도체 CTO 한평수 전무는 기술 세션 발표를 통해 차세대 Chiplet 및 AI SoC를 위한 인터커넥트 기술 트렌드와 퀄리타스반도체의 실리콘 검증 역량을 공유하면서 업계 전문가들로부터 높은 평가와 관심을 받았다. 김두호 퀄리타스반도체 대표는 “이번 ICCAD 2025에서 당사의 기술 경쟁력과 실질적인 사업 성과를 함께 보여드릴 수 있어 매우 뜻 깊었다”며 “앞으로도 글로벌 고객의 요구에 부합하는 고성능 인터페이스 IP와 검증된 솔루션을 지속적으로 제공하고, PCIe, UCIe 기반의 차세대 인터커넥트 시장에서 더 많은 성과를 만들어 나가겠다”고 말했다.

2025.11.25 15:54전화평

퀄리타스반도체, 美 AI 스타트업과 30억 규모 4나노 IP 공급 계약

초고속 인터페이스 IP 전문기업 퀄리타스반도체가 미국 AI 반도체 스타트업과 약 30억원 규모의 4nm(나노미터, 10억분의 1m) 공정의 UCIe PHY(32 Gb/s) 및 컨트롤러 IP, 그리고 PCIe Gen 6.0 PHY IP의 공급 계약을 체결했다고 31일 밝혔다. 이번 계약은 퀄리타스반도체 '스타트업 프로그램'의 일환으로, 혁신적인 기술을 보유한 초기 반도체 스타트업의 칩 개발을 지원하기 위해 추진됐다. 특히, 단일 PHY IP 공급에 그치지 않고 PHY와 컨트롤러를 통합한 서브 시스템 형태로 제공함으로써 고객의 개발 기간 단축과 시스템 완성도를 동시에 확보할 수 있도록 했다. 또한 이번 계약은 칩렛 인터페이스인 UCIe IP의 첫번째 라이센싱 계약이다. 김두호 퀄리타스반도체 대표는 “이번 계약은 글로벌 AI 반도체 시장 속에서 퀄리타스 IP의 기술 경쟁력과 신뢰성을 입증한 사례이자, 혁신 스타트업을 지원하기 위한 '스타트업 프로그램'의 성공적인 모델”이라며, “앞으로도 UCIe, PCIe를 비롯한 초고속 인터페이스 서브-시스템 IP를 중심으로 글로벌 고객의 차세대 칩 개발을 적극 지원하겠다”고 말했다.

2025.10.31 16:59전화평

퀄리타스반도체, 중화권 기업과 PCIe Gen 4.0 PHY IP 공급 계약 체결

초고속 인터페이스 IP 전문기업 퀄리타스반도체는 중화권 팹리스(반도체 설계전문) 고객사와 약 11억원 규모 PCIe Gen 4.0 PHY IP 공급 계약을 체결했다고 16일 밝혔다. 이번 계약은 8nm(나노미터, 10억분의 1m) 공정 기반 PCIe Gen 4.0 PHY IP를 제공하는 것으로, 퀄리타스반도체의 고성능, 저전력 인터페이스 기술이 고객사의 차세대 SoC(시스템 온 칩) 설계에 적용될 예정이다. 퀄리타스반도체의 PCIe PHY IP는 회사의 핵심 경쟁 제품으로, 글로벌 주요 고객사에 공급되어 검증된 실리콘 프로븐(Silicon-Proven) IP다. 특히 PCIe Gen 4.0 PHY IP는 국내외 고객사와의 다수 계약을 통해 폭넓은 레퍼런스를 확보하고 있으며, 양산 이력을 통해 안정성과 호환성을 인정받고 있다. 또한 지난해 5나노 선단공정 기반의 PCIe Gen 4.0 PHY IP 공급 계약을 성공적으로 체결했고, 올해 초 PCIe Gen 6.0 PHY IP 계약까지 연이어 성사하는 등 첨단 공정에서의 기술 경쟁력과 시장 신뢰성을 입증하며 PCIe 인터커넥트 분야의 리더십을 더욱 강화하고 있다. 이러한 다수의 PCIe IP 솔루션 계약은 빠르게 진화하는 인터커넥트 기술 트렌드와 시장 수요를 한발 앞서 예측하고, 선제적으로 연구개발에 투자해 온 퀄리타스반도체의 기술 리더십과 시장 통찰력을 보여주는 성과다. 향후 퀄리타스반도체는 PCIe PHY IP와 컨트롤러 IP를 아우르는 포트폴리오를 강화해 고객의 고성능 SoC 설계 요구를 적극적으로 지원하고 최적의 솔루션을 제공할 계획이다. 김두호 퀄리타스반도체 대표는 “최근 고객사들의 선단공정 및 고부가가치 인터커넥트 IP에 대한 수요가 급격히 증가하고 있다”며, “국내 최초로 PCIe Gen 6.0 PHY IP를 개발한 당사는 PHY부터 Controller까지 포괄하는 포트폴리오를 갖춘 전문 기업으로서, 앞으로도 지속적인 기술 혁신을 통해 시장의 요구에 기민하게 대응하고 고객 가치를 극대화해 나가겠다”고 강조했다.

2025.09.16 17:38전화평

퀄리타스반도체, 美 베리실리콘에 PCIe 6.0·CXL 3.0용 IP 공급

초고속 인터페이스 IP개발 전문기업 퀄리타스반도체는 4나노미터(nm) 공정의 PCIe 6.0 PHY IP를 미국 소재의 디자인하우스 업체인 베리실리콘(VeriSilicon Inc.)에 제공한다고 9일 공시했다. 퀄리타스반도체는 지난 6월 국내 최초로 PCIe 6.0 PHY IP 개발에 성공한 후 불과 5개월 만에 글로벌 고객사와 공급 계약을 성사시키며 기술력과 시장 경쟁력을 입증했다. 이번 계약은 조기 공급 프로그램(Early Access Program)의 일환으로, 고객사의 요구사항에 맞춘 설계 지원을 통해 개발 기간을 단축하고 시장 진입을 가속화했다. 이를 통해 퀄리타스반도체는 고부가가치 IP를 제공하는 글로벌 선도업체로서의 입지를 더욱 강화했다. 계약을 체결한 베리실리콘은 고성능 ASIC 설계와 IP 솔루션을 제공하는 글로벌 디자인하우스로, 반도체 설계 분야에서 뛰어난 전문성을 보유하고 있다. 베리실리콘의 솔루션은 데이터 센터, 인공지능, IoT 등 다양한 산업 분야에서 활용되고 있다. 퀄리타스반도체의 PCIe 6.0 PHY IP와 CXL 3.0 기술은 RISC-V 기반 SoC 플랫폼에서 고속 데이터 전송 및 효율적인 메모리 연결을 지원하는 핵심 기술로 자리잡고 있다. 이번 계약을 통해 퀄리타스반도체는 RISC-V 생태계에서의 입지를 한층 강화하며, 차세대 인터커넥트 기술 분야에서 기술적 리더십을 공고히 하게 되었다. 김두호 퀄리타스반도체 대표는 “이번 계약은 PCIe 6.0과 CXL 3.0 기반의 전략적 IP 공급의 첫 성과로, 기술적, 상업적으로 큰 의미가 있다”며 “베리실리콘과의 협력을 통해 다양한 어플리케이션으로 제품을 다변화하고, 혁신적인 솔루션 개발을 통해 기술 리더로 자리매김할 것”이라고 강조했다.

2025.01.09 10:29장경윤

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