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'4F스퀘어'통합검색 결과 입니다. (2건)

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中 CXMT, 고유전율 D램 소재 양산 적용...삼성·SK '맹추격'

D램 업계 후발주자인 중국 창신메모리(CXMT)의 기술 추격이 거세다. 기존 메모리 선두업체들의 전유물처럼 여겨지던 고유전율(High-k) 소재를 최신 D램 제품에 성공적으로 양산 적용한 것으로 확인됐다. 이에 삼성전자·SK하이닉스 등은 초격차를 통한 경쟁력 우위를 위해 4F스퀘어, 3D D램 등 차세대 구조 개발에 박차를 가하고 있다. 최정동 테크인사이츠 수석부사장은 27일 메모리 산업 동향 웨비나에서 최첨단 D램 기술 개발 로드맵에 대해 이같이 밝혔다. 테크인사이츠는 반도체 전문 분석기관이다. 中, 고성능 D램 소재 'High-k'도 본격 도입…선두 업체 맹추격 글로벌 D램 시장은 국내 삼성전자, SK하이닉스와 미국 마이크론 등 소위 빅3 기업이 주도해 왔다. 이들 기업은 12나노미터(nm)급 D램 및 고대역폭메모리(HBM) 상용화로 AI용 고부가 메모리 출하량을 적극 늘리는 추세다. 그러나 중국 기업들의 추격도 거세다. 현재 중국 최대 D램 제조업체인 CXMT는 G4(16나노급) 공정을 기반으로 DDR5 및 LPDDR5 제품 상용화에 성공한 상황이다. 최근에는 D램 내 트랜지스터에 기존 선두업체들만 적용하던 고성능 소재도 활용하기 시작한 것으로 나타났다. 최 부사장은 "중요한 점은 당사 조사 결과 CXMT가 G4 공정 및 LPDDR5X 제품에 High-k 메탈 게이트(HKMG) 기술을 성공적으로 도입했다는 것"이라고 강조했다. High-k는 회로 간 누설 전류를 막는 절연막에 쓰이는 소재다. 동일한 전압에서 더 많은 전하(전자의 흐름)을 저장할 수 있어, 기존 절연막 소재(실리콘산화물, SiO2) 대비 초미세 공정을 구현하는 데 용이하다. 때문에 삼성전자, SK하이닉스, 마이크론은 4~5년 전부터 이 소재를 도입하고 있다. HBM 기술 역시 고도화하고 있다. 현재 CXMT는 G3(18나노급) 공정을 사용해 HBM2E(3세대 HBM)의 리스크 양산(초도생산) 단계에 진입한 것으로 알려졌다. G4 공정 기반의 HBM3는 샘플링을 진행 중이다. 최 부사장은 "CXMT는 선두업체보다 약 2세대 정도 기술이 뒤쳐져 있으나, 더 높은 성능의 메모리 솔루션을 향해 HBM 로드맵을 꾸준히 발전시키고 있다"며 "G5(15나노급) D램 공정도 개발되고 있다"고 평가했다. D램 3강, 4F스퀘어·3D D램으로 기술 변혁 시도 삼성전자, SK하이닉스, 마이크론은 10나노미터 미만의 차차세대 D램(D0A) 개발로 기술 초격차를 꾀하고 있다. 특히 기존 D램의 구조를 바꾼 4F스퀘어, 3D D램을 가장 유력한 후보로 보고 있다. 최 부사장은 "현재 당사 평가로는 삼성전자와 SK하이닉스는 4F스퀘어 D램을 추진할 가능성이 높다"며 "반면 마이크론은 3D D램으로 바로 이동할 가능성이 더 높아 보인다"고 말했다. 4F스퀘어 D램은 메모리 셀(데이터를 저장하는 최소 단위)의 구조를 기존 수평이 아닌 수직으로 배치하는 차세대 D램이다. 스퀘어란, 셀 내 트랜지스터에 전압을 인가하는 구성 요소가 얼마나 큰 면적을 갖고 있는지 나타내는 척도다. 기존 D램은 6F스퀘어 구조를 갖추고 있다. 셀 면적이 줄어들수록 D램의 집적도가 높아져, 데이터 처리 성능 및 전력 효율성을 향상시킬 수 있다. 업계가 4F스퀘어 구조에 주목하는 이유다. 3D D램은 비트라인 혹은 워드라인을 세워, 기존 수평으로 집적되던 셀을 수직으로 적층하는 기술이다. 비트라인과 워드라인은 셀 내 트랜지스터를 동작하게 하는 구성 요소다. 3D D램 구조에서는 같은 면적에 더 많은 셀을 넣을 수 있고, 트랜지스터 간격이 넓어져 간섭 현상도 줄어든다. 다만 3D D램은 새로운 소재와 본딩 기술을 도입해야 하는 등 4F스퀘어 대비 기술적 난이도가 높다고 평가받는다. 최 부사장은 "3D D램은 여전히 기술적으로 매우 도전적인 과제로, D0A에서 상용화되기에는 상당한 공정 복잡성과 수율 문제를 야기한다"며 "이러한 이유로 4F스퀘어 D램이 D0A 세대에서 보다 실용적인 후보로 떠오르고 있다"고 설명했다.

2026.08.27 14:02장경윤 기자

삼성전자 "D램, 3D 시대 온다…핀펫 기술 적용 가속"

“BCAT 기반 기존 D램은 10nm(나노미터, 10억분의 1m) 미만에서 한계에 달할 것으로 전망됩니다.” 오정훈 삼성전자 마스터는 15일 소노캄 여수에서 진행 중인 '2025년도 반도체공학회 하계종합학술대회'에서 이같이 전망했다. BCAT(Buried Channel Array Transistor)은 메모리 셀의 누설 전류를 줄이기 위해 개발된 트랜지스터 구조다. 채널 길이를 줄여 D램 셀의 크기를 줄이고 집적도를 높인다. 10나노 이하의 극미세 공정에서는 트랜지스터 크기를 줄여도 소자 간 간격이 좁아져 소자 간 연결을 위한 메탈의 저항이 커지고, 발열 문제가 발생할 수 있다. 오 마스터는 “셀 트랜지스터 공간을 다른 형태로 확장해서 써야한다”며 3D D램을 대안으로 제시했다. 3D D램은 메로리를 수직으로 쌓은 제품이다. 기존 D램은 셀이 수평으로 배치됐다. 기존 D램 대비 더 많은 셀을 집적할 수 있기 때문에 용량을 늘리고, 성능도 상승한다. 삼성전자는 3D D램 구현에 핀펫(FinFET) 공정을 적용한다. 핀펫은 반도체 소자의 성능 향상을 위해 개발된 3차원 구조 공정 기술이다. 평면(2D) 구조 한계를 극복하고 채널을 3면으로 둘러싼 게이트를 통해 전류 흐름을 효과적으로 제어한다. 과거 주로 파운드리(반도체 위탁생산)에 활용되던 기술이다. 오 마스터는 “컨벤셔널 D램에서도 핀펫을 전 제품에 쓰는 시대가 찾아올 것”이라고 말했다. 그러면서 “핀펫이 적용된 칩이 언젠가는 나오겠지만 시점에 대해서는 언급할 수 없다”며 “열심히 개발하고 있는 단계”라고 전했다. 다만 핀펫 공정은 페리 트랜지스터에만 적용된다. 페리는 D램에서 셀 주변의 회로를 제어하는 트랜지스터다. 4F스퀘어 적용 여부에 대해서는 발표하지 않았다. 4F스퀘어는 현재 시장 주류 기술인 6F 스퀘어에서 셀 면적을 더 줄인 구조로, 집적도를 높일 수 있는 차세대 기술로 평가받는다. 그러나 삼성전자가 4F스퀘어를 기반으로 D램 구조를 바꾼 뒤, 3D D램을 개발한다는 점을 고려하면 4F스퀘어부터 핀펫 공정이 적용될 가능성이 크다. 그는 파운드리 기술이 메모리 공정으로 적용이 가속화되는 상황이냐는 질문에 “그렇다”고 긍정했다.

2025.07.15 16:14전화평 기자

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